要做一个控制脉冲信号出入的电动卷闸门控制电路图电路谁知道怎么做

VHDL数字频率计(一)
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VHDL数字频率计(一)
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VHDL数字频率计
&数字频率计是数字电路中的一个典型应用,实际的硬件设计用到的器件较多,连线比较复杂,而且会产生比较大的延时,造成测量误差、可靠性差。随着复杂可编程逻辑器件(CPLD)的广泛应用,以EDA工具作为开发手段,运用VHDL语言。将使整个系统大大简化。提高整体的性能和可靠性。
&VHDL(Very High Speed Integrated Circuit Hardware Description Language,超高速集成电路硬件描述语言)诞生于1982年,是由美国国防部开发的一种快速设计电路的工具,目前已经成为IEEE(The Institute of Electrical and Electronics Engineers)的一种工业标准硬件描述语言。相比传统的电路系统的设计方法,VHDL具有多层次描述系统硬件功能的能力,支持自顶向下(Top to Down)和基于库(LibraryBased)的设计的特点,因此设计者可以不必了解硬件结构。从系统设计入手,在顶层进行系统方框图的划分和结构设计,在方框图一级用VHDL对电路的行为进行描述,并进行仿真和纠错,然后在系统一级进行验证,最后再用逻辑综合优化工具生成具体的门级逻辑电路的网表,下载到具体的CPLD器件中去,从而实现可编程的专用集成电路(ASIC)的设计。
&数字频率计是直接用十进制数字来显示被测信号频率的一种测量装置。它不仅可以测量正弦波、方波、三角波、尖脉冲信号和其他具有周期特性的信号的频率,而且还可以测量它们的周期。经过改装,可以测量脉冲宽度,做成数字式脉宽测量仪;可以测量电容做成数字式电容测量仪;在电路中增加传感器,还可以做成数字脉搏仪、计价器等。因此数字频率计在测量物理量方面应用广泛。本设计用VHDL在CPLD器件上实现数字频率计测频系统,能够用十进制数码显示被测信号的频率,能够测量正弦波、方波和三角波等信号的频率,而且还能对其他多种物理量进行测量。具有体积小、可靠性高、功耗低的特点。数字频率计是计算机、通讯设备、音频视频等科研生产领域不可缺少的测量仪器。采用VDHL编程设计实现的数字频率计,除被测信号的整形部分、键输入部分和数码显示部分以外,其余全部在一片FPGA芯片上实现,整个系统非常精简,而且具有灵活的现场可更改性。在不更改硬件电路的基础上,对系统进行各种改进还可以进一步提高系统的性能。该数字频率计具有高速、精确、可靠、抗干扰性强和现场可编程等优点。
&数字频率计是近代电子技术领域的重要测量工具之一,同时也是其它许多领域广泛应用的测量频率计是一种数字显示频率测量仪表。
&数字频率计可以在规定的基准时间内把被测量脉冲数计下来换算成频率并以数字形式显示出来它即可测量正弦信号、方波信号和尖脉冲信号的频率,而且还能对其他多种物理量的变化频率进行测量,诸如机械振动次数、物体转动速度、明暗变化的闪光次数、单位时间内经过传送带的产品数量。等等。这些物理量的变化情况可以由有关传感器先转变成周期变化的电信号,然后用数字频率计测量单位时间内的变化次数,再用数码管显示出来。因此,字是一种应用范围较广的通用型数字仪器。该装置电路简单,制作容易,运用数字电路知识。即可完成设计任务。
工作原理及电路方框图
&数字频率计实际上是一个脉冲计数器,即在单位时间内计脉冲个数就可以得到信号频率,频率是计核心由计数器和脉冲信号发生器闸门电路、锁存器、显示器等组成。工作过程为。单位时间内脉冲控制闸门电路被测信号在1s内通过闸门,经计数器在单位时间内脉冲结束,同时关闭闸门电路完成计数值锁存,之后将计数器清零为下一次锁存做准备锁存数据直接送到译码显示。可控制计数锁存,译码显示系统使计数按照一定工作程序有条理地工作。(如计数→显示→清零→准备→下次测量)如果在系统中不接锁存器,显示器上的数字就会随计数器状态不停地变化,只有在计数器停止时数字才会稳定所以在计数后必须接锁存器。
& 交变电信号或脉冲的频率是指单位时间内所产生的电振动的次数或脉冲个数。用公式可表示为:
&&&&&&&&&&&&&&&&&&& f=N/t
式中,f为频率;N为在t时间内电振动次数或脉冲个数;t为产生N次电振动或N个脉冲需要的时间。
&为了采用数字技术实现对各种物理量频率的测量,除了用传感器将物理量变成电信号外,还需要把各种非矩形波的电振动信号通过波形变换电路(常用施密特电路)进行整形,将其变为规则的脉冲信号(数字信号),以便于计数器计数。
&实现频率测量的另一必备环节是时基电路。秘谓进基电路,就是产生时间标准信号的电路装置。既然是时间标准,就要求准确稳定。通常采用石英振荡器做成标准时间(例如1MHz或5MHZ)信号发生器。振荡器的输出信号先要进行整形,再进行人声分频,以获得各种时基信号。
&利用所获得的基准信号来触发控制电路,进而得到一定宽度的闸门信号,用它去控制主控门的开门时间――取样时间。在取样
时间里,主控门允许被测信号通往计数器计数。控制电路的另一
作用是在每次取样过后还要封锁主控门和时基信号输入,使计数器显示的数字停留一段时间,以便观测和读取数据。总之,控制电路的任务就是打开主控门计数,关上主控门显示,然后清零,此过程不断重复进行。
&频率计的原理图如下图所示。
&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&
&& 被测频率由A输入,经放大器放大和整形器整形后送往主控门。晶体振荡器的输出选择开关,将所需用的时基信号(如1s)作为控制电路的触发信号。控制电路输出接往主控门,该输出端仅在所选时间基准(即取样时间)内维持高电平,使主控门打开,被测信号在取样时间内通过主控门,进入计数器计数,计数数值由装在频率计面板上的显示器显示出来。此即噗所测信号的频率值。测量频率的原理波形如下示。
&&&&&&& 本频率计要求测量范围为.0.1~9999Hz,可测量1s和10s内的脉冲数,显示时间分“手动”和“自动”时,显示时间在0.5~5s之间连续可调;拨到“手动”时显示时间由“手动”按钮控制,输入被测信号幅度Vim&100mV
设计步骤和方法
单位时间脉冲电路
单位时间脉冲电路的目的是产生宽度为单位时间的正脉冲,控制闸门电路开启,并产生一定长度的低电平准备在次测量
& 多谐振荡即
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&量程自动控制的数字频率计
量程自动控制的数字频率计
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量程自动控制的数字频率计一、 实验目的:1、数字系统的设计与调试2、TTL 数字集成电路的使用3、量程自动控制的逻辑设计二、实验要求:设计、制作、调试一个量程自动控制的数字频率计,其要求如下:显示位数:四位,最大显示数9999闸门时间:10 ms,100 ms , 1 s, 根据被测频率大小,量程自动切换。量程:Ⅰ、100HZ―999.9KHZ, 闸门时间10msⅡ、10HZ―99.99KHZ,闸门时间100msⅢ、1HZ―0.999KHZ,闸门时间1s自动量程要求:计数器值大于9999 时(溢出),量程自动升高一档(闸门时间缩短十分之一),当计数值小于0800 时量程自动降低一档(闸门时间增大十倍)。输入被测电压:10HZ―1MHZ 方波或正弦波,幅度为3mv―3v(有效值)显示器件:TTL 电平的七段数码管(RS202 或2BS111)数字电路:TTL 数字集成电路,实验室能提供下述电路:7 4 L S 2 0 四输入端双与非门7 4 L S 2 7 P 三输入端三或非门7 4 L S 0 0 双输入端四与非门7 4 L S 2 4 8 BCD 七段译码器/驱动器7 4 L S 7 5 4 位双稳锁存器7 4 L S 9 0 二、五混合进制,十进制计数器7 4 L S 2 2 1 斯密特触发输入双单稳多谐振荡器7 4 L S 7 4 双D 触发器7 4 L S 7 6 双J―K 触发器三、实验原理:数字频率测量的原理图见图2-1,简单的数字频率计的方框图见图2-2。放大整形电路将输入的被测交流电压fx 放大,限幅,整形后变成方波或脉冲送主闸门,晶体振荡器送出的标准频率经分频后得到时间不等的一组闸门信号,经开关选择后也送主闸门,主闸门在闸门信号控制下打开或关闭,主闸门在开放的那一段标准的闸门时间T 内,计数器对被测频率fx 计数,待主闸门关闭后计数器已计至一定的脉冲数N,显然,f x = N/T在主闸门关闭后单稳电路先后送出两个脉冲作为锁存器的送数指令及计数器的清零指令,将计数器的数字送锁存器寄存,然后将计数器清零,以备下一次的测量,不同的量程可以通过切换闸门时间来改变。较高的量程对于较短的闸门时间。显然,闸门时间应选择适当,闸门时间过短则因计数有效位数少而降低了测量精度,过长则因计数器溢出也得不到正确的读数。合适的闸门时间(正确的量程)可以用波段开关手动选择,但是从使用方便来考虑,闸门时间应能自动选择在最佳点上,如被测频率f x 较高,致使计数溢出,闸门时间自动缩短(升量程);如被测频率f x 较低,计数器计数值不足某预定值,闸门时间自动增长(降量程)。为了保证闸门时间能最终稳定,升量程与降量程的读数之比不应是十比一,而应稍大于十比一,本实验要求读数大于9999 则升量程,小于0800 则降量程。
如果选择在大于9999 升量程,小于999 降量程,则如被测频率正好为1000.00KHZ 时,由于频率计在测量频率时1 个字的原理误差,量程将在Ⅰ(闸门时间为10)与Ⅱ(闸门时间为100 变动而不能最终稳定。实现自动量程首先要解决的问题是计数值的检测,即如何知道计数值已大于9999 或小于0800,对于标准的四位BCD(二十进制,8421 码)计数器来说,在计数过程中第四位计数的QD 出现过下降沿意味着计数器已溢出,(计数器值大于9999)。如果计数过程中第三位计数器的Q 3 D 未出现过上升沿,则意味着计数器值小于0800。因此,可以利用这两个特征很方便地检测出计数值的溢出或不足。其次要解决的一个问题是如何实现量程的升降,移位寄存器,可以左右移的移位寄存器,加法计数器,可逆计数器等都可以实现量程的升降。图2-3 触发器构成的移位寄存器实现量程升降的一个例子。工作过程是:降量程指令使Q1、Q2、Q3 置成100 状态,于是量程选择在Ⅲ档(闸门时间为1)。升降量程指令使状态右移,量程逐渐上升,直至适当的闸门时间被选中。与用左右移位寄存器的量程控制电路相比,它比较简单,但当从量程Ⅰ降到量程Ⅱ时,先要从Ⅰ降到Ⅲ,再从Ⅲ升到Ⅱ。
自动切换量程的同时必须同时切换小数点,否则,读数因无量程信息在很大程度上失去意义。晶体振荡器:T T L 电路很容易构成晶体振荡器,图2-4 是100KHZ 的晶体振荡器电路。本实验可利用晶体稳频的脉冲发生器(自制的),它输出有1MHZ,100KHZ,10KHZ,以及有单脉冲输出。对调试电路很有用处。输入放大器:它的好坏是决定频率计优劣的重要因素之一,本实验要求输入放大器在10HZ―1MHZ 频率范围内,对3mv―3v(有效值)的方波或正弦波输入电压提供足够的增益,经整形后可靠地触发TTL 电路.本实验可分两步做,首先做好一个四位的常规数字频率计。然后,再做自动量程控制部分。
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2015 UBM Asia Ltd. -- Use of this website is subject to its terms of use.
京ICP备号-1 |
京公网安备37 |&&&&&&& 考虑使用常见元件和降低成本,本设计采用直接测频率法,电路主要由五部分组成,其方框图如图1所示。&&& &&& 被测信号经放大、整形后,送入计数器进行计数;秒脉冲电路产生标准秒脉冲,经闸门控制电路形成控制信号控制计数器的工作模式;计数结果由直接显示出来。&&& &&& 电路原理图如图2所示。由以下几部分电路组成:&&& &&& 1.放大整形电路由Q3、Q4、VD3、VD4、4及外围元件组成,对输入信号进行放大、整形处理,将被测信号变换成矩形开关信号。输入信号由“lN”输入端输入,C3、C4、R6、R7、VD3、VD4组成输入及限幅保护电路。Q3、Q4组成宽频带放大器,Q3为结型场效应管、用于提高。4049反向器D5、D6和R14、R15构成施密特,将模拟信号变换成边沿陡直的方波脉冲送入计数器CP。C3、C4、C5、C7为耦合,C6、C8为旁路。2.秒脉冲产生电路秒脉冲由石英钟SM5544产生。该内包含32.768k、多级、放大驱动电路等。由于IC1与外接的32.768KHz实时晶振共同构成32.768KHz,其3脚交替输出窄脉冲信号。脉宽31.2ms,周期2s,两输出脉冲时差1s,经三极管QQ1、Q1、QQ2、Q2放大后再和IC2B作与非运算,输出周期为1s的窄脉冲。&&& &&& 各点波形如图3所示。&&&&&&& 3.闸门控制电路其作用是形成计数器所需的控制脉冲。秒脉冲信号经八进制计数/分配器CD4022(IC3)、与IC2D、IC2A、IC2C处理后,形成清零信号R和闸门控制信号INH。当R=1时,计数器直接清零;INH接闸门控制信号,当INH=0时,计数器开始计数,当INH=1时。计数器停止计数,但显示的结果被保留。计数器按清零(31.2ms)→计数(1s)→显示(6.9688s)→清零(31.2ms)→……的模式循环工作,在8s的一个循环周期中,清零和计数的时间一共只有1s多,而显示时间将近7s,可以方便地读取数据。各点波形如图4所示。&&& &&& 4.计数,显示电路根据技术要求。选择五位计数显示电路,采用U1~U5共5块十进制计数7段译码器HCF4026BE和5个共阴极数码管组成十进制计数显示器。4026内部包括十进制计数器和7段译码器两部分,译码输出可以直接驱动LED数码管。
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