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关于AHB里grant信号的问题
刚刚工作一周，看了AMBA2.0的spec文档，有一些不懂的地方。有master1和master2.传输过程是master1切换到master2，在不定长的情况下，怎么知道master1的grant1信号什么时候下降，然后切换到grant2上升。如果是定长的话通过Hburset信号就可以知道。（不考虑arbiter里优先级的问题，也不考虑split的方式）只是想知道有没有一个信号像HBURST一样直接确定不定长传输什么时候结束，我看了文档也没有找到答案，很着急，主管让我回答他，求大神解答啊AHB总线burst传输求助
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AHB总线burst传输求助
现在有这样一种情况，就是两个INCR4背靠背传输，那么在第二次INCR4传输时，还会出现non-sequence这个阶段吗？
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会的，因为是两个burst
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会啊，nonsequence跟burst的种类没有关系，它只会看address是不是一样！
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本帖最后由 l 于
17:02 编辑
& & 再追问一个问题，就是如果在single传输的情况下，在master发出控制命令后，ready信号拉低，此时master发出的控制信号（包括地址信号)还会保持在总线上吗？因为如果是burst传输的话，那么在本次控制信号发出后,如果ready信号拉低的话，控制信号会发生变化，那么single传输该怎样理解？
& && &还有就是既然master是控制发送次数的，而slaver可以根据控制信号来判断传输结束，那么burst传输的种类中的指定传输次数岂不是包含了冗余信息，这个问题又该如何理解，望赐教！
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& && &既然Hready为低的话，就说明data transfer没有完成啊，则master发出的信号肯定任然被总线所保持，而跟信号是single还是burst没有太大关系吧！
& &&&下面的问题是不是这个意思：例如，Burst type中有WRAP8/INCR8，是不是可以把它们分成2个WRAP4/INCR4？如果这样的话只用WRAP4/INCR4就可以避免WRAP8/INCR8和WRAP16/INCR16了。是这个意思么？
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本帖最后由 l 于
09:19 编辑
& & 第一个问题是说single应该是分为地址阶段和数据阶段，我的意思就是在地址阶段ready信号是高，但是在数据阶段变为低电平，在这种情况下在数据阶段的控制信息是保持地址阶段的信息呢还是被还原为原始信息，比如htrans会由non-seq状态转化为IDLE状态还是保持在IDLE状态？
& && &第二个问题是说传输次数是由master控制的，比如说master想要传输16次，那master是肯定知道自己要传输16次的，而作为slaver这边的话，他可以通过对htrans信号的监测，判断传输是否结束，那么master发出INCR16这种传输方式时，它是想将传输次数告诉谁呢？slaver并不需要这个信息啊，因为它可以通过判断htrans来侦测传输是否结束啊！
& && &第三个问题是背靠背传输的问题，比如讲master想要发送两次背靠背的single传输，按照AHB协议的话第二次传输的地址阶段应该是刚好对应前一次的数据阶段，但是slaver在第二次时的数据其实并没有准备好，但是因为前一次的数据已经在数据总线上了，这就导致第二次数据阶段与第二次传输的地址阶段之间隔了若干个周期的IDLE状态，这对于设计者判断传输何时结束带来了困难，这个问题有何解决办法，望赐教！
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第一个问题: 传输未完成，ready为低，保持原来的状态
第二个问题： master 与slave 通过 ready 来握手的，slave可以根据hburst来确定地址的范围以及下一个地址变化。
第三个问题：数据没有准备好，slave将ready拉低就可以拉。
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固定长度的 hburst 可让 aribiter 提早一个周期切换 hgrant。
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四楼的说法挺好的，同意！
[通过 QQ、MSN 分享给朋友]AMBA2.0协议的 AHB verilog代码
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AMBA2.0协议的 AHB verilog代码
本人在 哈工大深圳研究生学院 读研，毕设在做 AMBA2.0协议总线，自己研究了有俩月，代码写的不是很明白，进度挺紧，自己也很上火。求助，哪位大神能把 手中 AHB的 主机和从机代码，分享一下，真的感激不尽，如果有tb更好！期待贵人相助。
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<td class="t_msgfont" id="postmessage_、opencores上有源代码，自己慢慢分析；
2、grlib-gpl-1.3.7-b4144，这个工程文件，网上能直接下载到。工程/lib/gaisler/ambatest
希望对你有帮助
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加油，找来的代码也不好理解的。你也可以用状态机实现，然后生成verilog代码
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谢谢你的指导！但是还不清楚 怎么做！用什么软件跑，怎么才能生成 verilog 代码？&&求您详细点一下
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本帖最后由 redleaf1988 于
18:16 编辑
你说的文件，我已经下载下来啦。但是里面都是点vhd文件，不是纯粹的点v（即纯verilog语言）文件，现在需要verilog语言写的文件，求帮忙！自己一直用verilog语言 写，但是研究一个多月了，协议没理解透，写的不对！
我现在做的是 只用2.0的AHB，先不做APB那部分，计划有俩主机，俩从机！从机先做 ram或者fifo，主机就先做cpu，后续要有冲裁，
请问怎么实现，谁有参考代码？让我研究一下，这纯粹是自己毕设，不会拿去做工程，各位放心！
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redleaf1988
& &你手里有代码么？ 帮传一下呗，我毕设挺上火的，自己写代码 写不明白，我就是研究 参考。保证不去做工程，好么、？ 恳求啦qq邮箱：
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关于AMBA的笔记2(哥,断奶了)
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