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VHDL语言带同步置位、复位的D触发器
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3秒自动关闭窗口抗单粒子翻转可同步复位的扫描结构D触发器
申请号：.2 申请日：
摘要：本发明公开了一种抗单粒子翻转可同步复位的扫描结构D触发器,目的是提高抗单粒子翻转可同步复位的扫描结构D触发器的抗单粒子翻转能力。它由时钟电路、扫描控制缓冲电路、主锁存器、从锁存器、第一反相器电路和第二反相器电路组成;主锁存器由十八个PMOS管和十八个NMOS管组成,从锁存器由十个PMOS管和十个NMOS管组成,主锁存器和从锁存器均进行了双模冗余加固,且主锁存器和从锁存器中C2MOS电路结构均进行了改进,即分离互为冗余的C2MOS电路中的上拉电路和下拉电路。本发明抗抗单粒子翻转可同步复位的扫描结构D触发器的抗单粒子翻转能力强,适合用于抗单粒子翻转加固集成电路的标准单元库,应用于航空、航天等领域。
地址： 410073 湖南省长沙市开福区德雅路109号
发明(设计)人：
主分类号：
&实质审查的生效IPC(主分类):H03K
3/013申请日:
注：本法律状态信息仅供参考，即时准确的法律状态信息须到国家知识产权局办理专利登记簿副本。
&一种抗单粒子翻转可同步复位的扫描结构D触发器，抗单粒子翻转可同步复位的扫描结构D触发器由时钟电路、扫描控制缓冲电路、主锁存器、从锁存器、第一反相器电路和第二反相器电路组成，有五个输入端和两个输出端，五个输入端分别是CK即时钟信号输入端、D即数据信号输入端、SE即扫描控制信号输入端和SI即扫描数据输入端和RN即同步复位信号输入端；两个输出端分别是Q和QN，Q和QN输出一对相反的数据信号；时钟电路有一个输入端和两个输出端，输入端为CK，输出端为C、CN；时钟电路为一个两级反相器，由第一级反相器和第二级反相器组成；第一级反相器由第一PMOS管和第一NMOS管组成，第一PMOS管的栅极Pg1连接CK，漏极Pd1连接第一NMOS管的漏极Nd1，并作为时钟电路的一个输出端CN；第一NMOS管的栅极Ng1连接CK，漏极Nd1连接Pd1；第二级反相器由第二PMOS管和第二NMOS管组成，第二PMOS管的栅极Pg2连接CN，漏极Pd2连接第二NMOS管的漏极Nd2，并作为时钟电路的另一个输出端C；第二NMOS管的栅极Ng2连接CN，漏极Nd2连接Pd2；第一PMOS管和第二PMOS管的衬底连接电源VDD，源极Ps1、Ps2连接电源VDD；第一NMOS管和第二NMOS管的衬底接地VSS，源极Ns1、Ns2也接地VSS；扫描控制缓冲电路有一个输入端和一个输出端，输入端为SE，输出端为SEN；扫描控制缓冲电路由第三PMOS管和第三NMOS管组成；第三PMOS管的衬底和源极Ps3均连接电源VDD，第三NMOS管的衬底和源极Ns3均接地VSS；第三PMOS管的栅极Pg3连接SE，漏极Pd3连接第三NMOS管的漏极Nd3，并作为扫描控制电路的输出端SEN；第三NMOS管的栅极Ng3连接SE，漏极Nd3连接Pd3；第一反相器电路有一个输入端和一个输出端，输入端为SO，输出端为QN；第一反相器电路由第三十二PMOS管和第三十二NMOS管组成；第三十二PMOS管的衬底和源极Ps32均连接电源VDD，第三十二NMOS管的衬底和源极Ns32均接地VSS；第三十二PMOS管的栅极Pg32连接SO，漏极Pd32连接第三十二NMOS管的漏极Nd32，并作为第一反相器的输出端QN；第三十二NMOS管的栅极Ng32连接SO，漏极Nd32连接Pd32；第二反相器电路有一个输入端和一个输出端，输入端为SON，输出端为Q；第二反相器电路由第三十三PMOS管和第三十三NMOS管组成；第三十三PMOS管的衬底和源极Ps33均连接电源VDD，第三十三NMOS管的衬底和源极Ns33均接地VSS；第三十三PMOS管的栅极Pg33连接SON，漏极Pd33连接第三十三NMOS管的漏极Nd33，并作为第二反相器的输出端Q；第三十三NMOS管的栅极Ng33连接SON，漏极Nd33连接Pd33；主锁存器和从锁存器均为冗余加固的锁存器，并且主锁存器中还包括扫描结构，主锁存器和从锁存器前后串联，并均与时钟电路连接，主锁存器又与扫描控制缓冲电路连接，从锁存器还分别与第一反相器电路和第二反相器电路连接；其特征在于主锁存器有七个输入端和一个输出端，七个输入端为D、C、CN、SE、SEN、SI、RN，一个输出端为MO；主锁存器由十八个PMOS管和十八个NMOS管组成，主锁存器中所有PMOS管的衬底连接电源VDD，所有NMOS管的衬底接地VSS；第四PMOS管的栅极Pg4连接SI，漏极Pd4连接第五PMOS管的源极Ps5，源极Ps4连接电源VDD；第五PMOS管的栅极Pg5连接SEN，漏极Pd5连接第八PMOS管的源极Ps8，源极Ps5连接Pd4；第六PMOS管的栅极Pg6连接SE，漏极Pd6连接第七PMOS管的源极Ps7，源极Ps6连接电源VDD；第七PMOS管的栅极Pg7连接D，漏极Pd7连接Ps8，源极Ps7连接Pd6；第八PMOS管的栅极Pg8连接C，漏极Pd8连接第四NMOS管的漏极Nd4，源极Ps8连接Pd5；第九PMOS管的栅极Pg9连接RN，漏极Pd9连接Pd7，源极Ps9连接Pd6；第十PMOS管的栅极Pg10连接SI，漏极Pd10连接第十一PMOS管的源极Ps11，源极Ps10连接电源VDD；第十一PMOS管的栅极Pg11连接SEN，漏极Pd11连接第十四PMOS管的源极Ps14，源极Ps11连接Pd10；第十二PMOS管的栅极Pg12连接SE，漏极Pd12连接第十三PMOS管的源极Ps13，源极Ps12连接电源VDD；第十三PMOS管的栅极Pg13连接D，漏极Pd13连接Ps14，源极Ps13连接Pd12；第十四PMOS管的栅极Pg14连接C，漏极Pd14连接第十NMOS管的漏极Nd10，源极Ps14连接Pd11；第十五PMOS管的栅极Pg15连接RN，漏极Pd15连接Pd13，源极Ps15连接Pd12；第十六PMOS管的栅极Pg16连接Pd8，漏极Pd16连接第十六NMOS管的漏极Nd16并作为主锁存器的输出端MO，源极Ps16连接电源VDD；第十七PMOS管的栅极Pg17连接Pd14，漏极Pd17连接第十七NMOS管的漏极Nd17，源极Ps17连接电源VDD；第十八PMOS管的栅极Pg18连接Pd17，漏极Pd18连接第十九PMOS管的源极Ps19，源极Ps18连接电源VDD；第十九PMOS管的栅极Pg19连接CN，漏极Pd19连接第十八NMOS管的漏极Nd18，源极Ps19连接Pd18；第二十PMOS管的栅极Pg20连接Pd16，漏极Pd20连接第二十一PMOS管的源极Ps21，源极Ps20连接电源VDD；第二十一PMOS管的栅极Pg21连接CN，漏极Pd21连接第二十NMOS管的漏极Nd20，源极Ps21连接Pd20；第四NMOS管的栅极Ng4连接CN，漏极Nd4连接Pd8，源极Ns4连接第五NMOS管的漏极Nd5；第五NMOS管的栅极Ng5连接SE，漏极Nd5连接Ns4，源极Ns5连接第六NMOS管的漏极Nd6；第六NMOS管的栅极Ng6连接SI，漏极Nd6连接Ns5，源极Ns6接地VSS；第七NMOS管的栅极Ng7连接D，漏极Nd7连接Ns4，源极Ns7连接第八NMOS管的漏极Nd8；第八NMOS管的栅极Ng8连接SEN，漏极Nd8连接Ns7，源极Ns8连接第九NMOS管的漏极Nd9；第九NMOS管的栅极Ng9连接RN，漏极Nd9连接Ns8，源极Ns9接地VSS；第十NMOS管的栅极Ng10连接CN，漏极Nd10连接Pd14，源极Ns10连接第十一NMOS管的漏极Nd11；第十一NMOS管的栅极Ng11连接SE，漏极Nd11连接Ns10，源极Ns11连接第十二NMOS管的漏极Nd12；第十二NMOS管的栅极Ng12连接SI，漏极Nd12连接Ns11，源极Ns12接地VSS；第十三NMOS管的栅极Ng13连接D，漏极Nd13连接Ns10，源极Ns13连接第十四NMOS管的漏极Nd14；第十四NMOS管的栅极Ng14连接SEN，漏极Nd14连接Ns13，源极Ns14连接第十五NMOS管的漏极Nd15；第十五NMOS管的栅极Ng15连接RN，漏极Nd15连接Ns14，源极Ns15接地VSS；第十六NMOS管的栅极Ng16连接Pd14，漏极Nd16连接Pd16，源极Ns16接地VSS；第十七NMOS管的栅极Ng17连接Pd8，漏极Nd17连接Pd17，源极Ns17接地VSS；第十八NMOS管的栅极Ng18连接C，漏极Nd18连接Pd19，源极Ns18连接第十九NMOS管的漏极Nd19；第十九NMOS管的栅极Ng19连接Pd16，漏极Nd19连接Ns18，源极Ns19接地VSS；第二十NMOS管的栅极Ng20连接C，漏极Nd20连接Pd21，源极Ns20连接第二十一NMOS管的漏极Nd21；第二十一NMOS管的栅极Ng21连接Pd17，漏极Nd21连接Ns20，源极Ns21接地VSS；第四PMOS管、第五PMOS管、第六PMOS管以及第五NMOS管、第六NMOS管、第八NMOS管组成主锁存器中的扫描结构；从锁存器有三个输入端和两个输出端，三个输入端为MO、C、CN，两个输出端为SO、SON；从锁存器由十个PMOS管和十个NMOS管组成，从锁存器中所有PMOS管的衬底连接电源VDD，所有NMOS管的衬底接地VSS；第二十二PMOS管的栅极Pg22连接MO，漏极Pd22连接第二十三PMOS管的源极Ps23，源极Ps22连接电源VDD；第二十三PMOS管的栅极Pg23连接CN，漏极Pd23连接第二十二NMOS管的漏极Nd22，源极Ps23连接Pd22；第二十四PMOS管的栅极Pg24连接MO，漏极Pd24连接第二十五PMOS管的源极Ps25，源极Ps24连接电源VDD；第二十五PMOS管的栅极Pg25连接CN，漏极Pd25连接第二十四NMOS管的漏极Nd24，源极Ps25连接Pd24；第二十六PMOS管的栅极Pg26连接Pd25，漏极Pd26连接第二十六NMOS管的漏极Nd26并作为从锁存器的一个输出端SO，源极Ps26连接电源VDD；第二十七PMOS管的栅极Pg27连接Pd23，漏极Pd27连接第二十七NMOS管的漏极Nd27，源极Ps27连接电源VDD；第二十八PMOS管的栅极Pg28连接Pd27，漏极Pd28连接第二十九PMOS管的源极Ps29，源极Ps28连接电源VDD；第二十九PMOS管的栅极Pg29连接C，漏极Pd29连接第二十八NMOS管的漏极Nd28，源极Ps29连接Pd28；第三十PMOS管的栅极Pg30连接Pd26，漏极Pd30连接第三十一PMOS管的源极Ps31，源极Ps30连接电源VDD；第三十一PMOS管的栅极Pg31连接C，漏极Pd31连接第三十NMOS管的漏极Nd30并作为从锁存器的另一个输出端SON，源极Ps31连接Pd30；第二十二NMOS管的栅极Ng22连接C，漏极Nd22连接Pd23，源极Ns22连接第二十三NMOS管的漏极Nd23；第二十三NMOS管的栅极Ng23连接MO，漏极Nd23连接Ns22，源极Ns23接地VSS；第二十四NMOS管的栅极Ng24连接C，漏极Nd24连接Pd25，源极Ns24连接第二十五NMOS管的漏极Nd25；第二十五NMOS管的栅极Ng25连接MO，漏极Nd25连接Ns24，源极Ns25接地VSS；第二十六NMOS管的栅极Ng26连接Pd23，漏极Nd26连接Pd26，源极Ns26接地VSS；第二十七NMOS管的栅极Ng27连接Pd25，漏极Nd27连接Pd27，源极Ns27接地VSS；第二十八NMOS管的栅极Ng28连接CN，漏极Nd28连接Pd29，源极Ns28连接第二十九NMOS管的漏极Nd29；第二十九NMOS管的栅极Ng29连接Pd26，漏极Nd29连接Ns28，源极Ns29接地VSS；第三十NMOS管的栅极Ng30连接CN，漏极Nd30连接Pd31，源极Ns30连接第三十一NMOS管的漏极Nd31；第三十一NMOS管的栅极Ng31连接Pd27，漏极Nd31连接Ns30，源极Ns31接地VSS。
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深圳市祥源丰（Xanyufo）科技有限公司，创立于2010年，是电源管理芯片及被动元器件的专业分销商和供应商。历经多年不懈努力，深圳市祥源丰科技有限公司与CJ(长电).ON(安森美).TI(德州).ST(意法半导体).MAXIM(美信)的诸多著名的IC制造商和代理商建立起良好的合作关系，与国内著名设计厂商上海芯迈科技有限公司达成合作，授权代理。并凭借各方面的优势建立了大量的现货库存，公司主营电源管理芯片，电源管理系列之升压转换器、降压转换器、线性/低压降（LDO）稳压器，微处理器，音频解码芯片，广泛应用于工业电子，音视频及家电，数字医疗，汽车电子，安防产品，光电产品等。
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对产品的价格，只有更低，没有***低；
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技术支持：关于双D触发器，74HC74D_主板|显卡图纸
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关于双D触发器，74HC74D
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主板型号C.N78C七彩虹。
此板没有IO。
故障为不触发，排针进了此芯片第3脚，网上搜了，讲的都是些正弦，上升沿。
我只需要知道，几个信号都是谁发出的，怎样连接的。
就像IO那样解释一样，比如，排针发达高低高给18脚，然后IO发送高低高桥，然后桥返回SLP_S3。接着拉低PSON。
这块主板的高低高是74芯片发出的吗，第几脚发出的？
SLP_S3发到哪里去了，PSON直接是由桥拉低的吗？
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这个是上升沿触发带预置和清零的触发器
这个不是一两句说的清楚的
记得很久前有个帖子，大概10年吧
专门讨论过这个触发器的运用
ASUS A8E 的主板 在触发电路就采用了这个触发器
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哦，只碰到两块。
之前第一块，没有芯片换，心想就算了，反正不常见。
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本帖最后由 dyjs 于
09:41 编辑
1脚为置0端，2脚为数据，3脚为时钟，4脚为置1端，5脚为输出端，6脚为反向输出端，7脚为地。1、2、3、4、5为高电平，当3脚在电压跳变，也就是说电源开关按下去弹上来（上升沿）时，5脚就会跳变成低电平，然后控制后面的与非门和或非门连接的三极管B极为高电平，PSON绿线接低！
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今天又来一个，不过跟双D触发器毛关系都没有。
是这样的，我找到了ATX 14PSON连接的那个小三极管。
这个小三极管的B极通过一个102电阻接到了双DD触发器的4脚，我还以为是双D触发器来拉低PSON的。
我量三极管C极（PSON）时，明显不正常，待机时3点几V，我更换一个三极管就正常了。
我量了小三极管B极在待机时0.74V，开机后，变成3点几V了。
我不知道是谁把它置高的。
会是桥么？
而且不管开机关机，4脚始终都是5V，还是5脚始终也是5V，没有跳变。
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我今天也修到这个东东，弄不懂，看来得找个料把它给换了
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看了月饼的华硕D触发器。
今天又修到一块板，关不了机。
关机后，复位灯亮了。
一直查到HTVDDEN。这个信号桥没发出。
就想用复位来关闭，但我只要复位从高变低才能有效。
开启就不用它，直接开启。
所以需要上升沿。
复位从高变低是下降沿，所以还得用个反相门电路，接入CK脚。不过，先不说这些芯片能不能找到，时间也够久的了，一块主板30元，算了。看图纸，我的理解：
双D.jpg (63.38 KB, 下载次数: 50)
13:35 上传
通过调节D,CLR,PRE这三个脚的高低电平，不同的组合，Q,Q#有不同的输出，但他们的触发条件都是CLK这个脚。
Q#是Q的反相输出。即Q输出为高，那么Q#就要输出为低。
这样当CK脚从低变高的时候，Q和Q#就相相应的输出。
下面是D,CLR,PRE不同的组合，Q和Q#不同的输出。
值.jpg (29.96 KB, 下载次数: 53)
13:40 上传
D触发器，只需要有个上升沿触发，Q有相应的输出后，不管CK之后怎样变化，从高又变成低了，输出都不会变。
只有将CLR这个脚置为低电平，清空。触发又恢复到初始状态。
等待下一次触发上升沿。
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