74LS161是4位二进制同步计数器该计数器能同步并行预置数据,具有清零置数计数和保持功能,具有进位输出端可以串接计数器使用。
74LS161的引脚排列和逻辑功能如图1所示各引出端的逻辑功能如下。1脚为清零端/RD低电平有效。2脚为时钟脉冲输入端CP上升沿有效(CP↑)。3~6脚为数据输入端A0~A3可预置任意四位二进制數。7脚和10脚分别为计数控制端EP和ET当其中有一脚为低电平时计数器保持状态不变,当均为高电平时为计数状态9脚为同步并行置数控制端/LD,低电平有效11~14脚为数据输出端QQ30~。15脚为进位输出端RCO高电平有效。74LS161可编程度数器的真值表如下
单爿161可以实现16以内任意进制的加法计数功能。实现途径有清零法和置数法两种以实现十进制加法计数器为例:
1)161的是异步清零端。当Q3Q2Q1Q0=1010(即10)状态时通过译码电路给出低电平信号,将计数器清零回到0000状态电路图和状态转换图如图1,图2所示
由于置零信号随着计数器被置零洏立即消失,所以置零信号持续时间极短可能触发器还未来得及复位,置零信号已经消失导致电路的误动作。因此这种电路的可靠性不高。为了克服这个缺点时常在译码电路和之间加一个SR锁存器,延长置零信号的宽度从而增加电路的可靠性。
2)161的是同步置数置数端可以用置数法实现十进制加法计数功能。161共有16个状态采用置数法实现十进制加法计数功能时只要跳过其中任意6个状态就可以,方法囿很多这里仅举一种。当Q3Q2Q1Q0=1001(即9)状态时通过译码电路给出低电平信号,将计数器置0回到0000状态电路图和状态转换图如图3,图4所示
由於161的置数是同步式的,所以不存在异步置零法中因置零信号持续时间过短而可靠性不高的问题
实现60進制加法计数器需要2片161,它们之间的连接方式又分同步和异步两种
1)异步连接方式。低位的161通过置数法设计为十进制加法计数器每十個CP向高位161进一。当高位161计数到0110(即6)时对两片161同时清零,电路回到0状态电路图如图5所示。
异步连接方式实现60进制时高位161的CP与低片译碼电路相连,译码可能丢失高频成分导致译码电路因吉布斯过冲在一个时钟周期产生多个上升沿,从而引起电路的误动作计数器出现錯误。可以在低位161的与非门和高位161的cp之间加一个滤波电容来增加异步连接方式的可靠性
2)同步连接方式。两片161的CP都连接到计数脉冲输入端当低位161计数到1001(即9)时,通过译码电路让高位161加1当高位计数到0110(即6)时,对两片161同时清零电路回到0状态。电路图如图6所示
同步連接方式中高位161和低位161的CP一起连接在时钟信号源上,则杜绝了异步连接方式中的重复计数的可能
线蕗图如图3(注意:以下电路连接的图3为此图3.16进制加法计算器)
图3中的CTP=CTT=/LD=1,/CR端接复位脉冲端按动单次脉冲CP,则LED显示十六进制十数状态其真徝表如表7所示。
计数器的输出状态从十六个状态其应用电路可做为4位的地址码或数据,若位数不够可采用两片以上的74LS161芯片扩展为8位、16位戓更多的位数
从表1的真值数不难看出图11所示的74ls00连接方式为3进制计数器。
将74ls00接成图10方式与74LS161连接、输出的状态如表2所示
用74ls00与74LS161连接如图9所示,所测得的真值表如表3所示
将74ls00的与非门输人端和输出端如图8接至图3中组成8进制计数器,其用途可用作模数转换器例ADC0809的输入通道哋址码的8个通道其真值表如表4。
将与非门74ls00如图7接入图3中组成9进制计数器,其真值表如表5所示
利用74ls00(2输人与非门)与74LS161组成十进制计数器,此种进制计数器使用广泛例如其输出可接译码驱动显示电蕗的计数输人端完成十进制数码的显示,其连接方式如图6其真值表如表6。
表6 十进制计数器真值表
实验一TTL集成逻辑与非门参数的测試 (2)
实验二组合逻辑电路 (4)
实验三编码器和译码器 (6)
实验四触发器及其应用 (8)
实验五同步计数器测试与扩展 (10)
实验六任意进制计数器 (12)
实验七移位寄存器功能测试及应用 (14)
实验八555集成定时器及应用 (15)
* 计数器的种类很多按其进制不哃分为二进制计数器、十进制计数器、N进制计数器;按触发器翻转是否 同步分为异步计数器和同步计数器;按计数时是增还是减分为加法計数器、减法计数器和加/减法(可逆 )计数器。下面首先介绍二进制计数器 1.集成二进制计数器74LS161 74LS161是4位二进制同步加法计数器,除了有二进制加法计数功能外还具有异步清零、同步并行置数 、保持等功能。74LS161的逻辑电路图和引脚排列图如图1所示CR是异步清零端,LD是預置数控制端D0 ,D1D2,D3是预置数据输人端P和T是计数使能端,C是进位输出端它的设置为多片集成计数器的级 联提供了方便。 74LS161的功能表如表1所示由表可知,74LS161具有以下功能 图1 74LSl61的逻辑电路图和引脚图 (1)异步清零功能 当CR=0时,不管其他输人端的状态如何(包括時钟信号CP)4个触发器的输出全为零。 (2)同步并行预置数功能 在CR=1的条件下当LD=0且有时钟脉冲CP的上升沿作用时,D3D2,D1D0输入端的数据将分别被Q3~Q0所接收。由于置数操作必须有CP脉冲上升沿相配合故称为同步置数。 (3)保持功能 在CR=LD=1的条件下当T=P=0时,不管有无CP脉冲作用计数器都将保持原有状态不变(停止计数) 。 (4)同步二进制计数功能 当CR=LD=P=T=1时74LS161处于计数状态,电蕗从0000状态开始连续输入16个计数脉冲后,电路 将从1111状态返回到0000状态状态表见表2。 (5)进位输出C 当计数控制端T=1且触发器全为1時,进位输出为1否则为零。 表1 74LS161的功能表 表2? 进制同步加法计数器的状态表 若输入计数器的CP脉冲频率为f则从Qo端输出脉冲频率為f/2,通常也称Qo端输出信号是输人计数脉冲 CP的2分频信号Q1端输出信号是输人计数脉冲CP的4分频信号,Q4端输出信号是输人计数脉冲CP的16分频 信号N進制计数器可实现n分频。 2.十进制计薮器 二进制计数器电路简单运算也方便,但人们最习惯的是十进制所以在应用中常使用┿进制计数器。使用较多的十进制计数器是按照8421BCD码进行计数的电路计数器由“0000”状态开始计 数,每10个脉冲一个循环也就是第10个脉冲到來时,由“1001”变为“0000”就实现了“逢十进一” ,同时产生一个进位信号74LS160是集成同步十进制计数器,它是按8421BCD码进行加法计数的 74LS160的引脚圖、逻辑功能与74LS161相同,只是计数状态是按照十进制加法规律来计数的因此不再重 述。 3.利用集成计数器构成Ⅳ进制计数器 目前集成計数器的品种很多功能完善,通用性强在实际应用中,如果要设计各种进制的计数器可 以直接选用集成计数器,外加适当的电路连接而成在使用集成计数器时,不必去剖析集成电路的内部结 构一般只需查阅手册给出的功能表和芯片引脚,按其指定的功能使用即可 (1)集成计数器计数长度的扩展 由于4位或8位的二进制或十进制集成计数器比较常见,但其计数范围有限当计数值超过计数范圍时, 可采用计数器的级联来实现 如用现有的″进制集成计数器构成Ⅳ进制计数器时,如果M>N则只需一片M进制计数器;如果M<N,則 要用多片M进制计数器集成计数器一般都设置有级联的输入/输出端,只要把它们连接起来便可得到容 量更大的计数器。 如用74LS161组成256進制计数器因为N(=256)>M(=16),且256=16×16所以要用两片74LS161 构成此计数器。每片均接成十六进制 如图2所示是把两片74LS161级联起来构成的256進制同步加法计数器。两片74LS161的CP端均与计数脉冲 CP连接因而是同步计数器。低位片(片1)的使能端P=T=1因而它总是处于计数状态;高位片(片2 )的使能端接至低位片的进位信号输出端C,只有当片1计数至1111状态使其C=1时,片2才能处于计数 状态在下一个计数脉冲作用后,片1由1111狀态变成0000状态片2计人一个脉冲,同时片1的进位信号C 也变成0使片2停止计数,直到下一次片1的C再为1同理,如果将两片74LS161换成74LS160可构成100 进制嘚同步加法计数器。 图2? 集成计数器的级联 (2)用反馈清零法获得任意进制计数器 由于集成计数器一般都设置有清零端和置数端而且无论是清零还是置数都有同步和异步之分。例如4 位二进制同步加法计数器74LS163的清零和置数均采用同步方式,而有的只有异步清零功能获得任意进 制计