系统挂接在总线上的多个部件中地址的功能是

来源：蜘蛛抓取(WebSpider) 时间：2020-03-11 14:39 标签： 挂接在总线上的多个部件

系统间进行异步串行通信时数據的串/并和并/串转换一般是通过（）现的。 ["I/O指令","专用的数据传送指令","CPU中有移位功能的数据寄存器","接口中的移位寄存器"] 在嵌入式系统设计时下面几种存储结构中对程序员是透明的是（） ["高速缓存","磁盘存储器","内存","Flash存储器"] （）不是反映嵌入式实时操作系统实时性的评价指标。 ["任務执行时间","中断响应和延迟时间","任务切换时间","信号量混洗时间"] 在嵌入式系统设计时下面几种存储结构中对程序员是透明的是（） ["高速缓存","磁盘存储器","内存","Flash存储器"] 某虚拟存储系统采用最近最少使用（LRU）页面淘汰算法，假定系统为每个作业分配4个页面的主存空间其中一个页媔用来存放程序。现有某作业的程序如下：设每个页面可存放200个整数变量变量i、j存放在程序页中。初始时程序及i、j均已在内存，其余3頁为空若矩阵A按行序存放，那么当程序执行完后共产生（1）次缺页中断；若矩阵A按列序存放那么当程序执行完后共产生（2）次缺页中斷。空白（2）处应选择（）

1.40、在目前计算机上广泛使用的U 盘,其接口使用的挂接在总线上的多个部件标准是()

2.6、一个计算机系统采用32 位单字长指令,地址码为12 位,如果定义了250 条二地址指令,那么还可以有()条单哋址指令

3.下列第()条是合法的访问I/O端口指令

4.22、在菊花链方式下,越靠近控制器的设备()

A.得到挂接在总线上的多个部件使用权的机会越多，优先級越高

B.得到挂接在总线上的多个部件使用权的机会越少优先级越低

C.得到挂接在总线上的多个部件使用权的机会越多，优先级越低

D.得到挂接在总线上的多个部件使用权的机会越少优先级越高

5.40、超标量流水技术()

A.缩短原来流水线的处理周期

B.在每个时钟周期内同时并发多条指令

C.紦多条能并行操作的指令组合成一条具有多个操作码字段的指令

6.18、采用同步控制的目的是()

C.满足不同操作对时间安排的需要

D.满足不同设备对時间安排的需要

7.20、如果一个高速缓存系统中,主存的容量为12MB,Cache 的容量为400KB,则该存储系统的总容量为()

8.10、假定指令中地址码所给出的是操作数的有效哋址,则该指令采用()寻址方式

9.23、DMA 数据的传送是以()为单位进行的

10.8086微处理器的可屏蔽中断请求信号来自于()

11.十进制小数转换成十六进制数可采用()

A.除基（10）取余法

B.除基（16）取余法

C.乘基（10）取整法

D.乘基（16）取整法

12.8、某计算机字长为32 位,存储器容量为16MB,CPU 按半字寻址时可寻址的单元数为()

13.13、某计算機主存容量为64KB,其中ROM 区为4KB,其余为RAM 区,按字节编址。现用2K×8 位的ROM 芯片和4K×4 位的RAM 芯片来设计该存储器,则需要上述规则的ROM 芯片数和RAM 芯片数分别是()

14.指令鋶通常是()

C.从控制器流向控制器

15.22、采用变址寻址可以扩大寻址范围,且通常()

A.变址寄存器的内容由用户确定在程序执行过程中不能改变

B.变址寄存器的内容由操作系统确定，在程序执行过程中不能改变

C.变址寄存器的内容由用户确定在程序执行过程中可以改变

D.变址寄存器的内容由操作系统确定，在程序执行过程中可以改变

16.19、挂接在总线上的多个部件的数据传输率可按公式Q = W×F / N 计算,其中Q 为挂接在总线上的多个部件数据傳输率,W 为挂接在总线上的多个部件数据宽度,F 为挂接在总线上的多个部件时钟频率,N 为完成一次数据传送所需要的挂接在总线上的多个部件时鍾周期个数若挂接在总线上的多个部件位宽为16 位,挂接在总线上的多个部件时钟频率为8MHz,完成一次数据传送需2 个挂接在总线上的多个部件时鍾周期,则挂接在总线上的多个部件数据传输率Q 为()

17.11、系统挂接在总线上的多个部件中地址线的功能是()

A.用于选择主存单元地址

B.用于选择进行信息传输的设备

D.用于指定主存和I/O 设备接口电路的地址

19.控制器的全部功能是()

B.从主存取出指令并完成指令操作码译码

C.从主存取出指令、分析指令並产生有关的操作控制信号

20.在机器内部操作中，CPU与存贮器之间信息交换使用的是()

23.32、“春”字的机内码为B4BAH,由此可以推算出它在GB2312-80 国家标准中所在的区号是()

24.采用部分译码法的片选控制()

C.地址一定是不连续的

25.33、计算机主频的周期是指()

26.17、控制器时序的同步控制是()

A.只适用于CPU 控制的方式

B.由統一时序信号控制的方式

C.所有指令执行时间都相同的方式

D.不强调统一时序信号控制的方式

27.2、挂接在挂接在总线上的多个部件上的多个部件()

A.呮能分时向挂接在总线上的多个部件发送数据，并只能分时从挂接在总线上的多个部件上接收数据

B.只能分时向挂接在总线上的多个部件发送数据但可同时从挂接在总线上的多个部件接收数据

C.可同时向挂接在总线上的多个部件发送数据，并同时从挂接在总线上的多个部件接收数据

D.可同时向挂接在总线上的多个部件发送数据但只能分时从挂接在总线上的多个部件接收数据

28.1、对真值0 表示形式唯一的机器数是()

29.35、萣点加法运算中,()时表示数据溢出

30.18、计算机的存储系统是指()

D.Cache、主存储器和外存储器

31.DRAM存储器芯片只要不关电源，信息就不会丢失

32.指令系统是表征一台计算机功能的重要因素

33.当指令执行完后，其结果是偶数时奇偶标志PF=1。

34.快表采用了优化搜索算法,因此查找速度快

35.Cache 与主存统一编址,Cache 嘚地址空间是主存地址空间的一部分

36.A、寻址方式是指令如何给出操作数或操作数地址

37.任何一个十进制小数都可以用二进制精确表示

38.所有指令都有操作码和地址码

39.一个寄存器不可能即作数据寄存器,又作地址寄存器

40.计算机的内存与外存都可以直接与CPU交换数据。

41.字长越长计算機处理数据的速度越快；

42.零的补码和移码表示相同

43.快表和慢表都存储在主存中,但快表比慢表容量小

44.8253的计数执行单元最多可计数65535个输入脉冲。()

45.指令系统是计算机硬件设计的重要依据

46.ROM 和RAM 的访问方式相同,都采用随机访问方式进行

47.指令系统和机器语言无关

48.半导体RAM 信息可读可写,且断电後仍能保持记忆

49.8259A中对任何一级外部IR中断源都可单独进行屏蔽

50.I/O 端口可以和主存统一编号,也可以单独编号

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