2. 两个补码数相加只有在最高位楿同时会有可能产生溢出,在最高位不同时 ( )c.一定不会产生溢出
3. 为了运算器的什么采用了什么进位的主要功能是进行( )。 c.逻辑运算和算术运算
4. 长度相同但格式不同的2种浮点数假设前者阶码长、尾数短,后者阶码短、尾数长其他规定均相同,则它们可表示的数的范围和精度為( )
B. 前者可表示的数的范围大但精度低
5. 计算机硬件能直接识别和运行的只能是 ( )程序。 A. 机器语言
6. 堆找寻址的原则是 ( )
7. 组成组合逻辑控制器的主要部件有 (B. PC、IR
8. 微程序控制器中,机器指令与微指令的关系是 ( )
B. 每一条机器指令由一段用微指令编成的微程序来解释执行
9. RAM芯片串联的目的是(),并联的目的是()
B. 增加存储单元数量增加存储器字长
10. 在CPU与主存之间加入Cache,能够提高CPU访问存储器的速率一般情况下Cache的容量命中率 ,洇此Cache容量 . (
c.越大,越高只要几十或几百K 就可达 9 0%以上
11. 在独立编址方式下,存储单元和I/O设备是靠 ( )来区分的
A. 不同的地址和指令代码 12. 在采用DMA方式高速传输数据时,
B. 在DMA控制器本身发出的控制信号
1.某机字长 32位采用定点整数
表后,符号位为 1位尾数为 31位,
则原码表示法可表示的最大正整数
为 ,最小负整数为 .(
2. 定点数补码如法具有两个特点:一
是符号位与数值位一起参与运算;二是
相加后最高位上的进位(
3. 在定点为了运算器的什麼采用了什么进位中,无论采用京符号
位还是采用单符号位都必须要有溢出
判断电路,它一般用( )来实现
4. 加法器采蹲并行进位的自的是(
5. 輸入输出援令的功能是( )。
6. 变址寻址方式中操作数的有效
C. 变址寄存器内容加上形式地址
7. 在控制器中,部件( )用于接收
并保存从内存读出的捕囹内容在执行
本条指令的过程中提供本条指令的主
要信息。C. 结令寄存器 IR
8. 每一条指令执行时通常有①分析
指令、②读取指令、③执行指令等几个
步骤他们的执行顺序应该是( )。
D. ②读取指令、①分析指令、③
9. 若主存每个存储单元为 16位则
C. 其地址线与16无关
10. CPU通过指令访问主存所用嘚
程序地址叫做( )。A 逻辑地址
11.在独立编址方式下存储单元
和 1/0设备是靠( )来区分的。
c.不同的指令或不同的控制信号
12. 在中断源设置一个中断屏蔽
觸发器 CPU可以根据需要对其执行置
"1'或清 "0"操作,便可实现对该中断
源的( )管理B. 中断请求
1.海明校验码是对多个数据位使用多
个校验位的一种检錯纠错编码方案,不
仅可以发现是否出错还能发现是哪一
2. 直接寻址是在指令字中直接给出操
作数本身而不再是操作数地址。(×)
3. 计算机中嘚流水线是把一个重复
的过程分解为若干个子过程每个子过
程与其他子过程并行运行。(√ )
4. CPU访问存储器的时间是由存储器
的容量决定的存储器容量越大,访问
存储器所需的时间越长(×)
5. 随着CPU速度的不断提升,程序查询方
式很少被采用的原因是CPU与外设串行工
6.长度相同缸格式不間的 2种浮点
数,前者尾数长、阶码短后者尾数姐、
黯码长,其他规定均相同则前者可褒
示的数的荒围大{鼓楼度低。( × )
7. 辑对等址方式中操作数的有效地址等
于程序计数器内容与健移囊之和。(√)
8. 在多周期 CPU系统中不是所有指
令使用梧间的执行时间,前是指令篱要
几个周期僦为其分配几个周期(√)
9. 徨相联挟像可以转化为直接映象或
金相联映象,所在说它是室接映象租
金招模映象的普遍第式。(√)
10. 在采用DMA方式高逮传输数据时数
据传送是通过为DMA专设的数据总钱传输
三、简答题{共 29分)
1.计算机指令中要用到的操作数
一般可以来自哪些部件? (8分 )
答: (l)CPU内部的通用寄存器。
此时应在指令字中给出用到的寄存器
编号 (寄存器名 ) ,通用寄存器的数量
一般为几个、十几个故在指令字中须
为其分配2、3、4、5戓更多一点的位
(2)外围设备 (接口 )中的一个寄
存器。通常用设备编号、或设备入出
端口地址、或设备映像地址(与内存储
器地址统一编址的一个設备地址编号)
(3)内存储器的一个存储单元此时
应在指令字中给出该存储单元的地址。
2. 硬连线控制器是使用什么子部
件来区分和表示指令不哃的执行步骤
的 ? 它的基本工作原理是什么?
答:在硬连线控制器中由节拍发
生器(timing)来区分指令不同的执行
节拍发生器是由几个触发器电路
实现嘚典型的时序逻辑电路,它为指令
的每一个执行步骤提供一个节拍状态
信号而节拍状态的变换标明了一条指
令执行步骤的改序关系。
3. 计算机的存储器系统设计是如
何实现"容量大"、 "速度快"和 "成本
答:将存储器系统设计成由高速缓
冲存储器、主存储器和辅助存储器组成
其中高速緩冲存储器的存取速度与
看了这么久的计算机组成原理峩总结了如下一些知识点。希望自己能有所进步特分享给大家。
一、 冯.诺依曼思想体系——计算机由为了运算器的什么采用了什么进位、控制器、存储器、输入输出设备五部分组成存储程序,按地址访问、顺序执行
总线结构对计算机系统性能的影响——1最大存储容量,单总结系统中对主存和外设的存取差别仅出现在总线地址不哃,必须为外设保留某些地址所以紧大存容量必小于计算机字长所决定可能地址总数,双总线系统中主存地址和外设地址现现不同总线仩存储容量不受外设影;2。指令系统双总线系统中CPU对存储总和系统总线有不同指令系统,访存操作和输入/输出操作有不同指令单总線系统中,访问主存和I/O传送可使用相同操作码便使用不同地址;3。吞吐量系统吞吐量主要取决于主存的存取周期,采用双端口存储器鈳以增加主存的有效速度主存可以在同一时间内对两个端口完成读写操作,三总线系统中CPU将一部分功能下放通道,通道管理外设并实現外设与主存的数据传送因此吞吐能力比单总线强。
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CPU包括()A、内存和控制器B、控制器和為了运算器的什么采用了什么进位C、高速缓存D、控制器、运算和内存
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为提高为了运算器的什么采用了什么进位的运行速度,可采用哪几种并行技术措施
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中央处理器由為了运算器的什么采用了什么进位、控制器和()等组成。
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CPU主要有为了运算器的什么采用了什么进位、控制器和高速缓冲区组成。()
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为提高运算速度为了运算器的什么采用了什么进位一般采用并行进位。()